Si5324C
规格
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关键规格
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参考输入
2
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时钟输出
2
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相位抖动 (ps)
0.3
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最小输入频率 (MHz)
2
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最大输入频率 (MHz)
710
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最小输出频率 (MHz)
0.002
|
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最大输出频率 (MHz)
346
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输出格式
LVPECL；LVDS；CML；LVCMOS
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|
抖动衰减器
是
|
PCI Express
否
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|
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封装
QFN36
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封装尺寸 (mm)
6 × 6
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参考输入
2
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时钟输出
2
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相位抖动 (ps)
0.3
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最小输入频率 (MHz)
2
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最大输入频率 (MHz)
710
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最小输出频率 (MHz)
0.002
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最大输出频率 (MHz)
346
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输出格式
LVPECL；LVDS；CML；LVCMOS
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抖动衰减器
是
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PCI Express
否
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封装
QFN36
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封装尺寸 (mm)
6 × 6
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Si5324 任意频率精密时钟倍频器/抖动衰减器评估套件
Si5324 精密时钟接受 2 kHz 至 710 MHz 双时钟输入，生成 2 kHz 至 945 MHz 双时钟输出，最高支持 1.4 GHz 频率。Si5324 精密时钟采用 Silicon Labs 第三代 DSPLL® 技术，可在高度集成的 PLL 解决方案中进行任意速率频率合成，无需配置外部 VCXO 和环路滤波器元件。Si5324 支持低于 5 Hz 的环路 BW 值。
技术文档
软件与工具
Si5324 任意频率精密时钟倍频器/抖动衰减器评估套件
Si5324 精密时钟接受 2 kHz 至 710 MHz 双时钟输入，生成 2 kHz 至 945 MHz 双时钟输出，最高支持 1.4 GHz 频率。Si5324 精密时钟采用 Silicon Labs 第三代 DSPLL® 技术，可在高度集成的 PLL 解决方案中进行任意速率频率合成，无需配置外部 VCXO 和环路滤波器元件。Si5324 支持低于 5 Hz 的环路 BW 值。
质量与封装
社区与支持
