PCI Express (PCIe) 时钟发生器 Si522xx 和 Si521xx

We offer the highest performance, lowest power PCI Express Gen1/2/3/4/5 clock generators on the market. All devices feature low-power, push-pull output buffer technology, providing benefits of low-power consumption, reduced external terminating resistors, and smaller packaging. To optimize performance, PCI Express Gen1/2/3/4/5 clock generators support programmable drive strength, rise/fall times and output impedance, as well as down spread spectrum clock generation. The devices support the standard PCIe HCSL signaling format and can be externally terminated to support LVPECL, LVDS or CML levels. 开始使用 PCI Express.

符合 PCIe 规范
Gen1/2/3/4/5
Output termination resistors
Fully integrated

PCIe 时钟发生器一般规格

  • Complete portfolio of PCI Express Gen1/2/3/4/5 clocks and buffers
  • 种类广泛的电源:1.5 V, 1.8 V, 2.5 V, 3.3 V
  • 推拉式 HCSL 输出缓冲器技术
  • 12 位模数转换器 (ADC)
  • Low power conumption
  • 可编程扩频
  • 带有单个硬件引脚实现输出使能和扩频控制
  • I²C/SMBus programmable
  • 支持可选的 LVPECL、LVDS 或 CML 电平
  • -40 to +85 °C operation
  • 小尺寸 QFN 和 TDFN 封装
状态
Find the PCI Express Clock 选择列
选择列
零件号 参考输入 输出数量 输出频率 输出格式 描述 控制 相位抖动 (RMS) VDD (V) VDDO (V) 封装类型 封装尺寸 (mm) 时钟发生器 抖动衰减时钟 同步以太网/1588 符合 PCIe 规范 4G/LTE 无线时钟 英特尔 x86 时钟 扩频 抖动推荐范围 (fs) 线路阻抗匹配
1 4 25 100 HCSL;LVCMOS 1.5-1.8 V 4 路输出 PCIe 第 1/2/3/4 代 + 25 MHz LVCMOS 时钟发生器、 (带 85Ω 内部终端) I2C/针 0.4 1.5 至 1.8 1.5 至 1.8 QFN32 5 × 5 <= 500 85
1 12 25 100 HCSL;LVCMOS 1.5-1.8 V 12 路输出 PCIe 第 1/2/3/4 代 + 25 MHz LVCMOS 时钟发生器、 (带 85Ω 内部终端) I2C/针 0.4 1.5 至 1.8 1.5 至 1.8 QFN64 9 × 9 <= 500 85
1 8 25 100 HCSL;LVCMOS 1.5-1.8 V 8 路输出 PCIe 第 1/2/3/4 代 + 25 MHz LVCMOS 时钟发生器、 (带 100Ω 内部终端) I2C/针 0.4 1.5 至 1.8 1.5 至 1.8 QFN48 6 × 6 <= 500 100
1 1 100 100 HCSL 1 路输出 PCIe 第 3 代带 SS 时钟发生器 0.4 3.3 3.3 TDFN10 3x3 <= 1000 100
1 1 100 100 HCSL 1 路输出 PCIe 第 1 代带 SS 时钟发生器 3.3 3.3 TDFN10 3x3 <=86000 (pk-pk) 100
1 8 25 100 HCSL;LVCMOS 1.5-1.8 V 8 路输出 PCIe 第 1/2/3/4 代 + 25 MHz LVCMOS 时钟发生器、 (带 85Ω 内部终端) I2C/针 0.4 1.5 至 1.8 1.5 至 1.8 QFN48 6 × 6 <= 500 85
1 1 100 100 HCSL 1 路输出 PCIe 第 2 代时钟发生器 1.4 3.3 3.3 TDFN10 3x3 <= 3100 100
1 6 100 100 HSCL 6 路输出 PCIe 第 1/2/3 代时钟发生器 I2C/针 1 3.3 3.3 QFN32 5 × 5 <= 600 100
1 2 100 100 HCSL 1.5-1.8 V 2 路输出 PCIe 第 1/2/3/4 代时钟发生器、 (带 100Ω 内部终端) I2C/针 0.4 1.5 至 1.8 1.5 至 1.8 QFN20 3x3 <= 500 100
1 4 100 100 HSCL 4 路输出 PCIe 第 1/2/3 代时钟发生器 I2C/针 1 3.3 3.3 QFN24 4 × 4 <= 600 100
1 1 100 100 HCSL 1 路输出 PCIe 第 2 代带 SS 时钟发生器 1.4 3.3 3.3 TDFN10 3x3 <= 3100 100
1 9 100 100 HSCL 9 路输出 PCIe 第 1/2/3 代时钟发生器 I2C/针 1 3.3 3.3 QFN48 5 × 5 <= 600 100
0 1 100 100 HCSL 1 路输出 PCIe 第 1 代时钟发生器 3.3 3.3 TDFN10 3x3 <=86000 (pk-pk) 100
1 2 100 100 HCSL 1.5-1.8 V 2 路输出 PCIe 第 1/2/3/4 代时钟发生器、 (带 85Ω 内部终端) I2C/针 0.4 1.5 至 1.8 1.5 至 1.8 QFN20 3x3 <= 500 85
1 2 100 100 HCSL 2 路输出 PCIe 第 3 代带 SS 时钟发生器 0.4 3.3 3.3 TDFN10 3x3 <= 1000 100
1 2 25 100 HSCL;LVCMOS 2 路输出 PCIe 第 1/2/3 代带 25 MHz 参考时钟发生器 I2C/针 1 3.3 3.3 QFN24 4 × 4 <= 600 100
1 2 100 100 HCSL 2 路输出 PCIe 第 1 代时钟发生器 3.3 3.3 TDFN10 3x3 <=86000 (pk-pk) 100
1 5 25 100 HSCL;LVCMOS 4 路输出 PCIe 第 1/2/3 代带 25 MHz 参考时钟发生器 I2C/针 1 3.3 3.3 QFN24 4 × 4 <= 600 100
1 2 100 100 HCSL 2 路输出 PCIe 第 1 代带 SS 时钟发生器 3.3 3.3 TDFN10 3x3 <=86000 (pk-pk) 100
1 2 100 100 HCSL 2 路输出 PCIe 第 3 代时钟发生器 0.4 3.3 3.3 TDFN10 3x3 <= 1000 100
1 4 25 100 HCSL;LVCMOS 1.5-1.8 V 4 路输出 PCIe 第 1/2/3/4 代 + 25 MHz LVCMOS 时钟发生器、 (带 100Ω 内部终端) I2C/针 0.4 1.5 至 1.8 1.5 至 1.8 QFN32 5 × 5 <= 500 100
1 2 100 100 HCSL 2 路输出 PCIe 第 2 代时钟发生器 1.4 3.3 3.3 TDFN10 3x3 <= 3100 100
1 1 100 100 HCSL 1 路输出 PCIe 第 3 代时钟发生器 0.4 3.3 3.3 TDFN10 3x3 <= 1000 100

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